1 | JDF G |
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2 | // Created by Project Navigator ver 1.0 |
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3 | PROJECT radio_controller |
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4 | DESIGN radio_controller |
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5 | DEVFAM virtex2p |
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6 | DEVFAMTIME 0 |
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7 | DEVICE xc2vp4 |
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8 | DEVICETIME 0 |
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9 | DEVPKG fg456 |
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10 | DEVPKGTIME 0 |
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11 | DEVSPEED -6 |
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12 | DEVSPEEDTIME 0 |
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13 | DEVTOPLEVELMODULETYPE HDL |
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14 | TOPLEVELMODULETYPETIME 0 |
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15 | DEVSYNTHESISTOOL XST (VHDL/Verilog) |
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16 | SYNTHESISTOOLTIME 0 |
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17 | DEVSIMULATOR Modelsim |
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18 | SIMULATORTIME 0 |
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19 | DEVGENERATEDSIMULATIONMODEL VHDL |
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20 | GENERATEDSIMULATIONMODELTIME 0 |
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21 | SUBLIB radio_controller_v1_00_a VhdlLibrary vhdl |
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22 | LIBFILE C:\edk_user_repository\MyProcessorIPLib\pcores\radio_controller_v1_00_a\hdl\vhdl\radio_controller.vhd radio_controller_v1_00_a vhdl |
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23 | SOURCE C:\edk_user_repository\MyProcessorIPLib\pcores\radio_controller_v1_00_a\hdl\verilog\user_logic.v |
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24 | SUBLIB proc_common_v2_00_a VhdlLibrary vhdl |
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25 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\proc_common_pkg.vhd proc_common_v2_00_a vhdl |
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26 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\family.vhd proc_common_v2_00_a vhdl |
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27 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\or_muxcy.vhd proc_common_v2_00_a vhdl |
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28 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\or_gate.vhd proc_common_v2_00_a vhdl |
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29 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\counter_bit.vhd proc_common_v2_00_a vhdl |
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30 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\counter.vhd proc_common_v2_00_a vhdl |
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31 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\inferred_lut4.vhd proc_common_v2_00_a vhdl |
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32 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\srl_fifo2.vhd proc_common_v2_00_a vhdl |
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33 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_counter_bit.vhd proc_common_v2_00_a vhdl |
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34 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_counter.vhd proc_common_v2_00_a vhdl |
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35 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_counter_top.vhd proc_common_v2_00_a vhdl |
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36 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_occ_counter.vhd proc_common_v2_00_a vhdl |
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37 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_occ_counter_top.vhd proc_common_v2_00_a vhdl |
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38 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_adder_bit.vhd proc_common_v2_00_a vhdl |
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39 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_adder.vhd proc_common_v2_00_a vhdl |
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40 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pf_dpram_select.vhd proc_common_v2_00_a vhdl |
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41 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\srl16_fifo.vhd proc_common_v2_00_a vhdl |
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42 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\pselect.vhd proc_common_v2_00_a vhdl |
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43 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\valid_be.vhd proc_common_v2_00_a vhdl |
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44 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\ld_arith_reg.vhd proc_common_v2_00_a vhdl |
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45 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\mux_onehot.vhd proc_common_v2_00_a vhdl |
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46 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\down_counter.vhd proc_common_v2_00_a vhdl |
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47 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\ipif_pkg.vhd proc_common_v2_00_a vhdl |
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48 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\ipif_steer.vhd proc_common_v2_00_a vhdl |
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49 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\proc_common_v2_00_a\hdl\vhdl\direct_path_cntr_ai.vhd proc_common_v2_00_a vhdl |
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50 | SUBLIB interrupt_control_v1_00_a VhdlLibrary vhdl |
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51 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\interrupt_control_v1_00_a\hdl\vhdl\interrupt_control.vhd interrupt_control_v1_00_a vhdl |
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52 | SUBLIB wrpfifo_v1_01_b VhdlLibrary vhdl |
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53 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\wrpfifo_v1_01_b\hdl\vhdl\pf_dly1_mux.vhd wrpfifo_v1_01_b vhdl |
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54 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\wrpfifo_v1_01_b\hdl\vhdl\ipif_control_wr.vhd wrpfifo_v1_01_b vhdl |
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55 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\wrpfifo_v1_01_b\hdl\vhdl\wrpfifo_dp_cntl.vhd wrpfifo_v1_01_b vhdl |
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56 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\wrpfifo_v1_01_b\hdl\vhdl\wrpfifo_top.vhd wrpfifo_v1_01_b vhdl |
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57 | SUBLIB rdpfifo_v1_01_b VhdlLibrary vhdl |
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58 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\rdpfifo_v1_01_b\hdl\vhdl\ipif_control_rd.vhd rdpfifo_v1_01_b vhdl |
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59 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\rdpfifo_v1_01_b\hdl\vhdl\rdpfifo_dp_cntl.vhd rdpfifo_v1_01_b vhdl |
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60 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\rdpfifo_v1_01_b\hdl\vhdl\rdpfifo_top.vhd rdpfifo_v1_01_b vhdl |
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61 | SUBLIB opb_ipif_v3_01_a VhdlLibrary vhdl |
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62 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\reset_mir.vhd opb_ipif_v3_01_a vhdl |
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63 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\brst_addr_cntr.vhd opb_ipif_v3_01_a vhdl |
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64 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\opb_flex_addr_cntr.vhd opb_ipif_v3_01_a vhdl |
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65 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\brst_addr_cntr_reg.vhd opb_ipif_v3_01_a vhdl |
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66 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\opb_be_gen.vhd opb_ipif_v3_01_a vhdl |
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67 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\srl_fifo3.vhd opb_ipif_v3_01_a vhdl |
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68 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\write_buffer.vhd opb_ipif_v3_01_a vhdl |
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69 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\opb_bam.vhd opb_ipif_v3_01_a vhdl |
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70 | LIBFILE C:\EDK\\hw\XilinxProcessorIPLib\pcores\opb_ipif_v3_01_a\hdl\vhdl\opb_ipif.vhd opb_ipif_v3_01_a vhdl |
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71 | [STRATEGY-LIST] |
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72 | Normal=True |
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